ADSR controllato in tensione con uscite a gate di stato
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Il VC ADSR è la nostra rivisitazione del classico ADSR: ora più piccolo, più potente e di facile utilizzo.
Il circuito si basa su un doppio transistor "Current Mirror" (un integratore controllato in tensione) e sulla logica di commutazione.
Limiti di tempo di fase:
Attacco: Min 3,0ms (fino a 200µS con CV negativo) // Max 10s
Decadimento: Min 2,8ms (fino a 400µS con CV negativo) // Max 10s
Rilascio: Min 2,8ms (con Sustain al massimo) // Max 10s
Depth
26 mm
Width
8 hp
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